नवीनतम तकनीक! इंटेल ने आईएफएस डायरेक्ट कनेक्ट सम्मेलन में भविष्य की फाउंड्री प्रौद्योगिकी के लिए 3डी चिप प्रौद्योगिकी, लॉजिक यूनिट, बैक पावर सप्लाई की घोषणा की!

हाल ही में सैन जोस में एक आमंत्रण-केवल कार्यक्रम से पहले एक विशेष साक्षात्कार में, इंटेल ने अपने भविष्य के डेटा सेंटर प्रोसेसर की एक झलक साझा करके अपने अनुबंध ग्राहकों को पेश की जाने वाली नई चिप प्रौद्योगिकियों की रूपरेखा तैयार की। इन प्रगतियों में 16 गुना अधिक आंतरिक कनेक्टिविटी के साथ सघन तर्क और 3डी स्टैक्ड चिप्स शामिल हैं, और वे पहली उच्च-स्तरीय प्रौद्योगिकियों में से एक होंगे जिन्हें कंपनी अन्य कंपनियों के चिप आर्किटेक्ट्स के साथ साझा करेगी।

ये नई प्रौद्योगिकियाँ इंटेल में वर्षों से चल रहे परिवर्तन की परिणति होंगी। प्रोसेसर निर्माता एक ऐसी कंपनी से परिवर्तित हो रहा है जो केवल अपने स्वयं के चिप्स बनाती है जो एक फाउंड्री में परिवर्तित होती है जो अन्य कंपनियों के लिए चिप्स बनाती है और अपनी उत्पाद टीम को सिर्फ एक अन्य ग्राहक के रूप में देखती है। सैन जोस में आईएफएस डायरेक्ट कनेक्ट इवेंट को नए बिजनेस मॉडल के लिए एक उभरती पार्टी के रूप में डिजाइन किया गया था।

इंटेल आंतरिक रूप से प्रौद्योगिकियों के इस संयोजन का उपयोग सर्वर सीपीयू कोड-क्लियरवॉटर फ़ॉरेस्ट में करने की योजना बना रहा है। कंपनी का मानना ​​है कि सैकड़ों अरबों ट्रांजिस्टर के साथ सिस्टम-ऑन-चिप के रूप में उत्पाद, उस लक्ष्य का एक उदाहरण है जिसे उसके फाउंड्री व्यवसाय के अन्य ग्राहक हासिल कर सकते हैं। इंटेल में डेटा सेंटर टेक्नोलॉजी और डिस्कवरी के निदेशक एरिक फ़ेट्ज़र ने कहा, "हमारा लक्ष्य गणना को प्रति वाट सर्वोत्तम प्रदर्शन तक पहुंचाना है जिसे हम प्राप्त कर सकते हैं।" इसका मतलब है कंपनी की सबसे उन्नत विनिर्माण तकनीक- Intel 18A का उपयोग करना। उन्होंने कहा, "हालांकि, अगर हम प्रौद्योगिकी को पूरे सिस्टम पर लागू करते हैं, तो अन्य संभावित समस्याएं भी होती हैं, और सिस्टम के कुछ हिस्से जरूरी नहीं कि दूसरों की तरह स्केलेबल हों।" मूर के नियम के अनुसार तर्क आम तौर पर पीढ़ी-दर-पीढ़ी अच्छी तरह से स्केल करता है। कंप्यूटर तो और भी पिछड़े हैं.

इन वास्तविकताओं का सामना करते हुए, जैसा कि अब सभी अग्रणी प्रोसेसर निर्माताओं का सामना करना पड़ रहा है, इंटेल ने क्लियरवॉटर फ़ॉरेस्ट के सिस्टम को उनके मुख्य कार्यों तक तोड़ दिया, प्रत्येक फ़ंक्शन को बनाने के लिए सबसे उपयुक्त तकनीक को चुना, और प्रौद्योगिकियों के एक नए सेट का उपयोग करके उन्हें वापस एक साथ जोड़ दिया। इसका परिणाम यह है कि सीपीयू आर्किटेक्चर को 300 बिलियन ट्रांजिस्टर तक बढ़ाया जा सकता है।

क्लियरवॉटर फ़ॉरेस्ट में, अरबों ट्रांजिस्टर को तीन अलग-अलग प्रकार के सिलिकॉन आईसीएस में विभाजित किया जाता है, जिन्हें नंगे चिप्स या छोटे चिप्स कहा जाता है, जो आपस में जुड़े होते हैं और एक साथ पैक किए जाते हैं। सिस्टम के केंद्र में इंटेल 18ए प्रक्रिया का उपयोग करके निर्मित 12 प्रोसेसर कोर तक के छोटे चिप्स हैं। इंटेल 3 का उपयोग करके निर्मित तीन "बेस चिप्स" के शीर्ष पर छोटे चिप्स को 3 डी में स्टैक्ड किया गया है, यह प्रक्रिया इस साल लॉन्च किए गए सिएरा फॉरेस्ट सीपीयू के कंप्यूटिंग कोर का निर्माण कर रही है। सीपीयू का मुख्य कैश, वोल्टेज रेगुलेटर और आंतरिक नेटवर्क बेस चिप पर स्थापित किया जाएगा। वरिष्ठ प्रधान अभियंता पुष्कर रानाडे ने कहा: "स्टैकिंग जंप को छोटा करके, बड़े कैश को सक्षम करते हुए, गणना और मेमोरी के बीच विलंबता में सुधार करता है।"

अंत में, सीपीयू का I/O सिस्टम इंटेल 7 का उपयोग करके निर्मित दो चिप्स पर स्थित होगा, 2025 तक, चिप कंपनी की सबसे उन्नत प्रक्रियाओं से पूरी चार पीढ़ी पीछे होगी। वास्तव में, ये छोटे चिप्स अनिवार्य रूप से सिएरा फ़ॉरेस्ट और ग्रेनाइट रैपिड्स सीपीयू में उन छोटे चिप्स के समान हैं, जो विकास व्यय को कम करने में सक्षम हैं।

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