最新テクノロジー！ IntelがIFS Direct Connectカンファレンスで将来のファウンドリ技術の3Dチップ技術、ロジックユニット、バック電源を発表！

最近、サンノゼでの招待者限定イベントに先立って独占インタビューを行ったインテルは、将来のデータセンタープロセッサーの概要を共有することで、契約顧客に提供する新しいチップ技術の概要を説明しました。 これらの進歩には、ロジックの高密度化や内部接続性が 16 倍向上した 3D スタックチップが含まれており、これらは同社が他社のチップアーキテクトと共有する最初のハイエンドテクノロジーの 1 つとなります。

これらの新しいテクノロジーは、インテルの数年にわたる変革の集大成となります。 このプロセッサメーカーは、自社のチップのみを製造する企業から、他社向けのチップを製造し、自社の製品チームを単なる顧客の1つとみなすファウンドリへ移行しようとしています。 サンノゼでの IFS Direct Connect イベントは、新しいビジネス モデルの発表パーティーとして企画されました。

Intel 内部では、このテクノロジーの組み合わせを、開発コード名 Clearwater Forest というサーバー CPU で使用する予定です。 同社は、数千億個のトランジスタを備えたシステムオンチップとしてのこの製品は、ファウンドリ事業の他の顧客が達成できる目標の一例であると考えている。 「私たちの目標は、達成できるワットあたり最高のパフォーマンスで計算を行うことです」とインテルのデータセンターテクノロジーおよびディスカバリー担当ディレクターのエリック・フェッツァー氏は述べています。 これは、同社の最も先進的な製造テクノロジーである Intel 18A を使用することを意味します。 「しかし、この技術をシステム全体に適用すると、他の潜在的な問題が発生し、システムの一部は必ずしも他の部分ほど拡張性があるとは限りません」と同氏は付け加えた。 ロジックは通常、ムーアの法則に従って、世代から世代へと適切に拡張されます。」他の機能はそうではありません。たとえば、SRAM (CPU のキャッシュ) はロジックに遅れをとっています。プロセッサをプロセッサーの残りの部分に接続する I/O 回路は、コンピューターはさらに後進的です。

すべての大手プロセッサ メーカーが現在直面しているように、これらの現実に直面して、インテルはクリアウォーター フォレストのシステムをコア機能にまで分解し、各機能を構築するのに最適なテクノロジを選択し、新しいテクノロジ セットを使用してそれらをつなぎ合わせました。 その結果、CPU アーキテクチャは最大 3,000 億個のトランジスタまでスケールアップできるようになりました。

クリアウォーター フォレストでは、数十億個のトランジスタが、ベア チップまたは小型チップと呼ばれる 3 つの異なるタイプのシリコン IC に分割され、相互接続され、パッケージ化されています。 システムの中心となるのは、Intel 18A プロセスを使用して構築された最大 12 個のプロセッサ コアを備えた小型チップです。 小型チップは、Intel 3 を使用して構築された 3 つの「ベース チップ」の上に 3D で積み重ねられ、このプロセスは、今年発売された Sierra Forest CPU のコンピューティング コアを製造しています。 CPUのメインキャッシュ、電圧レギュレータ、内部ネットワークはベースチップ上にインストールされます。 シニア主席エンジニアの Pushkar Ranade 氏は、「スタッキングによりジャンプが短縮され、より大規模なキャッシュが可能になるため、コンピューティングとメモリ間のレイテンシが改善されます。」と述べています。

最後に、CPU の I/O システムは、Intel 7 を使用して構築された 2 つのチップ上に配置され、2025 年までに、チップは同社の最も先進的なプロセスより完全に 4 世代遅れることになります。 実際、これらの小型チップは Sierra Forest および Granite Rapids CPU の小型チップと本質的に同じであるため、開発費を削減できます。

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